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CHAPTER 8 8-BIT TIMER/EVENT COUNTERS 2 TO 5
User’s Manual U15905EJ2V1UD
245
TMCEn
Counting is disabled after the counter is cleared to 0 (counter disabled)
Start count operation
TMCEn
0
1
Control of count operation of 8-bit timer/event counter n
TMCn
(n = 2 to 5, m = 3, 5)
TMCn6
0
TMCm4
Note
LVSn
LVRn
TMCn1
TOEn
Mode in which clear & start occurs on match between TMn register and CRn register
PWM (free-running) mode
TMCn6
0
1
Selection of operation mode of 8-bit timer/event counter n
Individual mode
Cascade connection mode (connected with TM2 or TM4)
TMCm4
0
1
Selection of individual mode or cascade connection mode
Unchanged
Reset timer output F/F to 0
Set timer output F/F to 1
Setting prohibited
LVSn
0
1
Setting of status of timer output F/F
LVRn
0
1
0
1
After reset: 00H
R/W
Address: TMC3 FFFFF646H
TMC3 FFFFF647H
Disable inversion operation
Enable inversion operation
High active
Low active
TMCn1
0
1
Other than PWM (free-running)
mode (TMCn6 = 0)
Controls timer F/F
PWM (free-running) mode
(TMCn6 = 1)
Selects active level
Disable output (TOn pin is low level)
Enable output
TOEn
0
1
Timer output control
<7>
65
43
2
10
TMC4 FFFFF656H
TMC5 FFFFF657H
Note
Bit 4 of the TMC2 and TMC4 registers is fixed to 0.
Cautions 1. The LVSn and LVRn bit settings are valid in modes other than the PWM mode.
2. Do not rewrite the TMCn1 bit and TOEn bit at the same time.
3. When switching to the PWM mode, do not rewrite the TMCn6 bit and the LVSn and LVRn
bits at the same time.
4. Before rewriting the TMCn6 bit or TMCm4 bit, stop the timer operation.
Remarks 1. In the PWM mode, the PWM output is set to the inactive level by TMCEn = 0.
2. When the LVSn and LVRn bits are read, 0 is read.
3. The values of the TMCn6, LVSn, LVRn, TMCn1, and TOEn bits are reflected to the TOn output
regardless of the TMCEn value.
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